首页
在设计时序逻辑电路时,对原始状态表中的状态化简,其目的是____。
2024-08-04 12:50:40
电子技术基础(三)(04730)
在设计时序逻辑电路时,对原始状态表中的状态化简,其目的是____。
【正确答案】:去掉多余项
上一篇:
____触发方式的钟控触发器在时钟脉冲有效时间内,若激励信号变化多次,则触发器的输出存在____现象。
下一篇:
一般来说,时序逻辑电路中所需的触发器数目n与电路状态数N应满足如下关系式:____。若某设计中经状态化简后,电路的状态数N=7,